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Vivado与Modelsim联合仿真卡在Executing analysis and compilation step...

1.问题描述

Vivado与Modelsim联合仿真卡在Executing analysis and compilation step…,调不出Modelsim
在这里插入图片描述

2.分析原因:

Vivado Tcl Console有2个报错:信号已经声明。发现是上图中输出端口的变量类型在端口列表下定义。
在这里插入图片描述

3.解决方案:

更改后问题得到解决。
在这里插入图片描述

http://www.xdnf.cn/news/1772.html

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